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PDF 21140A Data sheet ( Hoja de datos )
| Número de pieza | 21140A | |
| Descripción | PCI Fast Ethernet LAN Controller Hardware Reference Manual | |
| Fabricantes | Digital Equipment | |
| Logotipo |  |
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DIGITAL Semiconductor 21140A
PCI Fast Ethernet LAN Controller
Hardware Reference Manual
Order Number: EC–QN7NF–TE
Revision/Update Information: This is a revised document. It supersedes the
DIGITAL Semiconductor 21140A PCI Fast
Ethernet LAN Controller Hardware Reference
Manual, EC–QN7NE–TE.
Digital Equipment Corporation
Maynard, Massachusetts
http://www.digital.com/semiconductor
1 page  
Contents
Preface
1 Introduction
1.1
1.1.1
1.2
General Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
21140A Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Hardware Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1–1
1–2
1–3
2 Signal Descriptions
2.1 21140A Pinout . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.2 Signal Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2–1
2–3
3 Registers
3.1 Configuration Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.1
Configuration Register Mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.2
Configuration Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1.2.1
Configuration ID Register (CFID–Offset 00H) . . . . . . . . . . . . . . . . . . . .
3.1.2.2
Command and Status Configuration Register (CFCS–Offset 04H) . . . .
3.1.2.3
Configuration Revision Register (CFRV–Offset 08H). . . . . . . . . . . . . . .
3.1.2.4
Configuration Latency Timer Register (CFLT–Offset 0CH) . . . . . . . . . .
3.1.2.5
Configuration Base I/O Address Register (CBIO—Offset 10H) . . . . . . .
3.1.2.6
Configuration Base Memory Address Register (CBMA–Offset 14H) . . .
3.1.2.7
Subsystem ID Register (SSID–Offset 2CH) . . . . . . . . . . . . . . . . . . . . . .
3.1.2.8
Expansion ROM Base Address Register (CBER–Offset 30H) . . . . . . . .
3.1.2.9
Configuration Interrupt Register (CFIT–Offset 3CH) . . . . . . . . . . . . . . .
3.1.2.10
Configuration Device and Driver Area Register (CFDD–Offset 40H) . .
3.2 CSR Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.1
Control and Status Register Mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.2
Host CSRs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3–1
3–2
3–2
3–2
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3–10
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3–17
3–18
iii
5 Page 
Figures
1–1
2–1
3–1
3–2
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4–12
4–13
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5–1
5–2
5–3
5–4
21140A Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
21140A Pinout Diagram (Top View) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CFID Configuration ID Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CFCS Command and Status Configuration Register . . . . . . . . . . . . . . . . . . . . . .
CFRV Configuration Revision Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CFLT Configuration Latency Timer Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CBIO Configuration Base I/O Address Register . . . . . . . . . . . . . . . . . . . . . . . . . .
CBMA Configuration Base Memory Address Register . . . . . . . . . . . . . . . . . . . . .
SSID Subsystem ID Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CBER Expansion ROM Base Address Register . . . . . . . . . . . . . . . . . . . . . . . . . .
CFIT Configuration Interrupt Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CFDD Configuration Driver Area Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR0 Bus Mode Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR1 Transmit Poll Demand Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR2 Receive Poll Demand Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR3 Receive List Base Address Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR4 Transmit List Base Address Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR5 Status Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR6 Operating Mode Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR7 Interrupt Enable Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR8 Missed Frames and Overflow Counter . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR9 Boot ROM, Serial ROM, and MII Management Register . . . . . . . . . . . . . .
CSR10 Boot ROM Programming Address Register . . . . . . . . . . . . . . . . . . . . . . .
CSR11 General-Purpose Timer Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR12 General-Purpose Port Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
CSR15 Watchdog Timer Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Descriptor Ring and Chain Structure Examples . . . . . . . . . . . . . . . . . . . . . . . . . .
Receive Descriptor Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDES0 Receive Descriptor 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDES1 Receive Descriptor 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDES2 Receive Descriptor 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDES3 Receive Descriptor 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Transmit Descriptor Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
TDES0 Transmit Descriptor 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
TDES1 Transmit Descriptor 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
TDES2 Transmit Descriptor 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
TDES3 Transmit Descriptor 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Perfect Filtering Setup Frame Buffer Format . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Imperfect Filtering . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Imperfect Filtering Setup Frame Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Slave Read Cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Slave Write Cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Configuration Read Cycle . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Bus Arbitration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
1–5
2–2
3–2
3–4
3–7
3–8
3–10
3–11
3–12
3–13
3–14
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4–4
4–8
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4–10
4–12
4–13
4–16
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4–19
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4–24
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5–4
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5–6
5–7
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Hoja de datos destacado
| Número de pieza | Descripción | Fabricantes |
| 21140 | DEC Chip | Digital Equipment |
| 21140A | PCI Fast Ethernet LAN Controller | Digital Equipment |
| 21140A | PCI Fast Ethernet LAN Controller Hardware Reference Manual | Digital Equipment |
| Número de pieza | Descripción | Fabricantes |
| SLA6805M | High Voltage 3 phase Motor Driver IC. |
 Sanken |
| SDC1742 | 12- and 14-Bit Hybrid Synchro / Resolver-to-Digital Converters. |
 Analog Devices |
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